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文檔簡介
1、隨著VLSI深亞微米工藝的不斷進步，集成電路中的芯片的互連延時，以及互連線之間的信號完整性問題已經成為決定電路性能的關鍵因素。相比于優(yōu)化傳統(tǒng)的自動化布線指標（比如布通率，擁擠）所采用的策略，考慮更精確時延估計，串擾優(yōu)化等信號完整性指標的布線策略往往要用到電路的高階矩。而傳統(tǒng)布線框架所采用的Elmore時延模型其本質是電路的一階矩，實驗已證明它對快速變化的信號具有較低的精確度，且從電路的一階矩也無法反映出電路上傳輸信號的波形質量。所以最近
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