基于多相時鐘產生電路的DLL的研究與應用.pdf_第1頁
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文檔簡介

1、延遲鎖相環(huán)(DLL)電路是當前高頻時鐘產生電路設計中的重要研究課題之一，它在減小輸出信號抖動、降低鎖定時間方面與傳統的鎖相環(huán)相比有獨特的優(yōu)勢和作用。本課題項目來源于中芯國際設計服務部I/O組，基于SMIC0.13μm CMOS工藝，完成一款應用于DVI RX中的延遲鎖相環(huán)電路。
　　 本文首先詳細研究了高頻時鐘產生電路的基本理論，包括了鎖相環(huán)，電荷泵鎖相環(huán)以及延遲鎖相環(huán)的電路原理、結構，對比介紹了它們各自的特點和應用。在此基礎上

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