OpenSPARC T1處理器的存儲機制研究及驗證.pdf_第1頁
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文檔簡介

1、隨著微電子工藝水平的不斷發(fā)展，摩爾定律不斷得到驗證，傳統(tǒng)的單核處理器已經(jīng)很難適應(yīng)諸多應(yīng)用對處理器性能的要求，多核多線程處理器應(yīng)運而生。高速緩存(Cache)是多核多線程處理器片內(nèi)的核心組件，其性能對處理器的整體性能有著至關(guān)重要的影響。因此，本文選擇了Sun公司的開源64位CMT處理器OpenSPARC T1為研究對象，對該處理器的Cache工作機制及優(yōu)化策略、評測工具展開了較為深入的研究，并在上述工作基礎(chǔ)上，根據(jù)本科教學的需求設(shè)計了Op

2、enCache教學平臺用于本科生輔助學習。
　　本文首先介紹了當前微處理器的發(fā)展趨勢，對其相關(guān)技術(shù)特別是Cache工作機制進行了詳細的闡述。根據(jù)OpenSPARC T1處理器開放的源代碼，分析了該處理器的體系結(jié)構(gòu)。在此之后，本文對OpenSPARC T1處理器的Cache及數(shù)據(jù)交互機制進行了深入的研究，重點分析了OpenSPARC T1處理器所采用的6種Cache優(yōu)化技術(shù)，并通過SimpleScalar模擬器進行了驗證。在此基礎(chǔ)上

3、，本文對OpenSPARC T1處理器Cache抖動問題的優(yōu)化方法進行探索，使用一種軟硬件優(yōu)化技術(shù)相結(jié)合的空間鎖環(huán)優(yōu)化技術(shù)，計算了該技術(shù)在提升OpenSPARC T1處理器系統(tǒng)性能方面的理論收益值。
　　其次，本文設(shè)計了一種專為Cache教學服務(wù)的OpenCache教學平臺，OpenCache基于OpenSPARC T1處理器硬件平臺，其設(shè)計源于在學界和工業(yè)界大量應(yīng)用的開源模擬器SimpleScalar。本文詳細分析了該平臺的設(shè)計

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