基于SerDes芯片8b-10b編解碼電路的設(shè)計(jì)及驗(yàn)證.pdf_第1頁(yè)
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1、SerDes芯片是一種高速串并轉(zhuǎn)換接口芯片，即采用時(shí)分多路復(fù)用(TDM)、點(diǎn)對(duì)點(diǎn)的通信技術(shù)，在發(fā)送端多路低速并行信號(hào)被轉(zhuǎn)換成高速串行信號(hào)，經(jīng)過(guò)傳輸媒體(光纜或銅線(xiàn))，最后在接收端將高速串行信號(hào)重新轉(zhuǎn)換成低速并行信號(hào)。本文設(shè)計(jì)了基于 SerDes芯片的8b/10b編解碼電路，詳細(xì)介紹了從前端代碼到后端APR生成版圖的整個(gè)設(shè)計(jì)流程。
　　SerDes芯片的編解碼模塊是基于IBM公司于1983年發(fā)明的8b/10b編碼協(xié)議進(jìn)行設(shè)計(jì)的。8b

2、/10b編碼方式的特點(diǎn)是：數(shù)據(jù)流中連續(xù)的“1”或“0”個(gè)數(shù)不超過(guò)5個(gè)，避免傳輸中數(shù)據(jù)的丟失；具有DC補(bǔ)償功能，不會(huì)出現(xiàn)DC偏移；可根據(jù)編碼規(guī)則檢測(cè)錯(cuò)誤信息；采用特殊字符進(jìn)行控制。
　　本論文設(shè)計(jì)的8b/10b編解碼模塊采用Verilog HDL語(yǔ)言完成各個(gè)模塊的RTL級(jí)電路功能設(shè)計(jì)；用Synopsys公司的綜合工具Design Complier進(jìn)行門(mén)級(jí)電路綜合；用Synopsys公司的自動(dòng)布局布線(xiàn)工具Astro進(jìn)行最終的版圖設(shè)計(jì)；

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