高性能CPU中除法器的設計.pdf_第1頁
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文檔簡介

1、CPU的核心功能之一是實現基本算術運算。在四則基本運算中，除法在技術實現上具有較高的復雜性，所以硬件除法器的設計一般會成為CPU設計中的重點與難點。對于嵌入式CPU來說，其設計目標更加關心成本的降低，使得其算術運算單元在性能設計指標上需要有較大的靈活性，從而使硬件占用較小的面積。本文以國家863項目為依托，根據項目的實際需求并結合除法器設計領域新的理論與實踐進展，實現了兩種實用的整數除法器。第一種以低成本簡約化設計為著眼點，采用最基本的

2、基數-2算法，以標準加法器作為核心部件，輔以最低限度的硬件邏輯構成數據通道，實現除法功能；第二種在前一種設計所采用的基本算法中引入中間數據的冗余表示形式，極大地提高了中間運算的處理速度，使得一周期內能做兩次基數-2加法的中間運算，從而形成一種基數-4算法。與傳統的以ROM或PLA等存儲部件實現的基數-4除法器相比，這種以基數拆分的方式實現的基數-4除法器在不損失性能的前提下大幅降低了硬件結構的復雜度。本文尾部的章節(jié)在兩種除法器設計的基礎

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