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文檔簡介
1、隨著超大規(guī)模集成電路的高速發(fā)展，在越來越多的電子產(chǎn)品應(yīng)用中，數(shù)字信號處理技術(shù)正在逐步取代模擬信號處理技術(shù)。作為模擬-數(shù)字轉(zhuǎn)換過程中必不可少的模數(shù)轉(zhuǎn)換器(ADC)，也因?yàn)閿?shù)字技術(shù)的發(fā)展而面臨新的挑戰(zhàn)與機(jī)遇。
子ADC作為流水線模數(shù)轉(zhuǎn)換器的關(guān)鍵單元之一，正與流水線模數(shù)轉(zhuǎn)換器一同進(jìn)行著一步步的優(yōu)化以便能更好的適應(yīng)高速高精度的要求。本文設(shè)計(jì)了一種用于12bit，50MS/s流水線ADC的子ADC電路。
首先，通過查閱
2、大量資料文獻(xiàn)，了解了當(dāng)前國際國內(nèi)轉(zhuǎn)換器領(lǐng)域的研發(fā)狀況并對相關(guān)的ADC、流水線ADC及子ADC知識(shí)點(diǎn)進(jìn)行了理論分析。在此基礎(chǔ)上，對子ADC進(jìn)行了具體設(shè)計(jì)。之后在TSMC0.18μm工藝下，應(yīng)用Cadence Spectre()、Synopsys Hspice()等軟件對所設(shè)計(jì)的子ADC的核心電路：比較器進(jìn)行仿真分析，結(jié)果表明比較器延遲時(shí)間控制在0.25ns以下。由于數(shù)字冗余校正技術(shù)的應(yīng)用，子ADC性能表現(xiàn)良好，能用于高速高精度流水線ADC
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