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文檔簡介
1、雷達(dá)信號(hào)處理平臺(tái)是高速實(shí)時(shí)信號(hào)處理系統(tǒng)的重要組成部分，廣泛用于高速雷達(dá)信號(hào)的處理。本文采用DSP+FPGA的體系架構(gòu)，設(shè)計(jì)實(shí)現(xiàn)了一款低功耗、高實(shí)時(shí)性、可靠性、高速高性能、穩(wěn)定性的雷達(dá)信號(hào)處理板系統(tǒng)。
本文首先根據(jù)設(shè)計(jì)指標(biāo)和方案得出雷達(dá)信號(hào)處理板總體處理流程框架，整體處理架構(gòu)采用FPGA+多核 DSP架構(gòu)。FPGA采用Xilinx Kintex-7系列高性能器件。DSP采用TI KeyStone系列8核定浮點(diǎn)DSP TMS320
2、C6678。FPGA完成系統(tǒng)上電控制、時(shí)鐘和外圍設(shè)備管理、AD數(shù)據(jù)采集及數(shù)據(jù)預(yù)處理、雷達(dá)時(shí)序生成、通信接口擴(kuò)展以及對(duì)外高速接口實(shí)現(xiàn)。DSP負(fù)責(zé)系統(tǒng)管理以及后端數(shù)據(jù)處理和信息處理等工作。本文重點(diǎn)圍繞 DSP為核心的常見外設(shè)及接口設(shè)計(jì)。完成DSP BOOT啟動(dòng)。實(shí)現(xiàn)DSP與FPGA之間大數(shù)據(jù)快速傳輸，研究DSP存儲(chǔ)空間的合理化分配過程中，得到常見的存儲(chǔ)優(yōu)化方法。FPGA設(shè)計(jì)方面，詳細(xì)論述了系統(tǒng)的時(shí)鐘設(shè)計(jì)和外圍設(shè)備管理，數(shù)據(jù)預(yù)處理算法實(shí)現(xiàn)，根
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