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文檔簡介
1、兩種BCD碼轉成格雷碼VHDL語言設計與仿真波形一,用while....loop語句libraryieeeuseieee.std_logic_1164.allentitygelei1ispt(B:instd_logic_vect(4downto0)D:outstd_logic_vect(3downto0))endgelei1architectureoneofgelei1isbeginprocess(B)variabletemp:std_
2、logicvariablen:integerbeginn:=0whilen4looptemp:=B(n)xB(n1)D(n)=tempn:=n1endloopendprocessendone二,用f.....loop.....語句libraryieeeuseieee.std_logic_1164.allentitygeleiispt(B:instd_logic_vect(4downto0)D:outstd_logic_vect(3dow
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