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文檔簡介
1、隨著語音技術(shù)應(yīng)用的發(fā)展，語音信號數(shù)字處理的實時性要求越來越突出。這就要求在系統(tǒng)設(shè)計中，對系統(tǒng)的硬件環(huán)境要求更高。隨著語音處理算法的日益復(fù)雜，用普通處理器對語音信號進行實時處理，己經(jīng)不能滿足需要。專用語音信號處理芯片能解決實時性的要求，同時對器件的資源要求也是最低的。
本文利用新一代可編制邏輯器件在數(shù)字信號處理領(lǐng)域的優(yōu)勢，對語音信號低碼率編碼的FPGA實現(xiàn)進行了深入研究。第一章綜述了低碼率語音編碼的現(xiàn)狀，然后在第二章對LPC的聲
2、碼器的編解碼原理進行了較為詳細的分析，并對其不足之處進行了一些分析，在此基礎(chǔ)上，對LPC-10聲碼器進行了仿真，得到了處理過后的數(shù)據(jù)。最后，通過使用殘差激勵代替周期脈沖—隨機噪聲二元激勵，讓合成語音的質(zhì)量得到了一定的提升。第三章對電子系統(tǒng)的設(shè)計趨勢進行了分析，指出了FPGA是未來電子設(shè)計主流實現(xiàn)手段。然后對可編程邏輯器件的內(nèi)部結(jié)構(gòu)進行了介紹，接著詳細討論了EDA設(shè)計流程的內(nèi)容。最后對關(guān)系設(shè)計電路性能的的靜態(tài)時序分析進行了詳細分析，以及對
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