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1、本文首先系統(tǒng)性介紹了國(guó)內(nèi)外高速解調(diào)接收機(jī)的研究及發(fā)展?fàn)顩r。其次介紹了高速解調(diào)器的關(guān)鍵技術(shù)及具體實(shí)現(xiàn),包括并行數(shù)字下變頻、匹配濾波、時(shí)鐘恢復(fù)、載波恢復(fù)以及均衡和糾錯(cuò)等技術(shù),根據(jù)詳細(xì)的公式推導(dǎo)和簡(jiǎn)化,建立了電路實(shí)現(xiàn)結(jié)構(gòu)模型。接著給出了各部分電路的詳細(xì)設(shè)計(jì),并給出設(shè)計(jì)中采用的FPGA,ADC,以及模擬前端等關(guān)鍵器件的性能分析,最終完成高速解調(diào)器的整機(jī)設(shè)計(jì),對(duì)整機(jī)指標(biāo)進(jìn)行了測(cè)試完成結(jié)果分析。
高速解調(diào)接收設(shè)備可實(shí)時(shí)接收高分衛(wèi)星及多種航
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