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文檔簡介
1、本課程設計的本課程設計的VHDL程序，仿真波形及實驗輸出波程序，仿真波形及實驗輸出波形libraryieeeuseieee.std_logic_1164.alluseieee.std_logic_unsigned.allentityMGPPispt(input:instd_logic_vect(4downto0)clkf1:instd_logicf2:instd_logic_vect(1downto0)fout:outintegerra
2、nge255downto0)ENDarchitectureoneofMGPPissignalq1q2:integerrange255downto0signalDd2:integerrange255downto0signalfull:std_logicsignals1s2s3s4:integerrange255downto0beginprocess(clk)variabler1:std_logic_vect(4downto0)begini
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