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1、 本文采用基于數(shù)論變換的算法結(jié)構(gòu)，完成了有限域快速多項式相乘運算核的設(shè)計及FPGA實現(xiàn)和測試驗證，包括從算法設(shè)計、系統(tǒng)結(jié)構(gòu)設(shè)計、各個子模塊的設(shè)計和實現(xiàn)、系統(tǒng)聯(lián)調(diào)仿真到FPGA的下載實現(xiàn)和測試整個流程。研究設(shè)計了一種具有自主知識產(chǎn)權(quán)的高速、高精度的有限域多項式相乘運算核。提出了一種可行的、易于硬件實現(xiàn)的結(jié)構(gòu)，具有無誤差、速度快、設(shè)計復(fù)雜度低的優(yōu)點。在Xilinx公司的100萬門的VirtexⅡ器件上實現(xiàn)，進行一次兩個256點的有限域多項
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