基于51核的SOC物理設(shè)計(jì)與驗(yàn)證.pdf_第1頁(yè)
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1、集成電路版圖設(shè)計(jì)的主要任務(wù)是布局布線，本文的主要研究方向是基于Astro的深亞微米布局布線流程、基于Hercules的物理驗(yàn)證過(guò)程及基于PrimeTime的版圖后靜態(tài)時(shí)序分析。本文首先介紹了物理設(shè)計(jì)工具Astro及靜態(tài)時(shí)序分析工具PrimeTime，總結(jié)了版圖設(shè)計(jì)中的主要延時(shí)模型、寄生參數(shù)提取及時(shí)序優(yōu)化。然后針對(duì)SOC芯片GVC(Gas Volume Controller，油量控制芯片)，提出了基于Charter0.35um工藝的Ast

2、ro后端設(shè)計(jì)流程，GVC芯片的后端設(shè)計(jì)主要包括：布局規(guī)劃--進(jìn)行手工擺放宏單元模塊及基于電壓降和電遷移的電源/地布線；布局--進(jìn)行時(shí)序和擁塞驅(qū)動(dòng)的標(biāo)準(zhǔn)單元布局，同時(shí)考慮了芯片的性能和可布線性：時(shí)鐘樹(shù)綜合(CTS)及布線--采用門(mén)控單元時(shí)鐘樹(shù)綜合法對(duì)GVC芯片進(jìn)行了時(shí)鐘樹(shù)綜合，分布式布線方式使得布線時(shí)間大大縮短。文中第四章分別給出了以上四步驟地設(shè)計(jì)原理、步驟及腳本。接著第五章介紹了GVC芯片的物理驗(yàn)證過(guò)程、原理及結(jié)果。本文第六章還介紹了版

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