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文檔簡介
1、論文在詳細(xì)研究JPEG2000的核心編碼部分(Part-1)的基礎(chǔ)上，提出了一種低緩存、全集成的JPEG2000編解碼器的VLSI架構(gòu)。首先，采用MATLAB語言對JPEG2000的算法進行了軟件實現(xiàn)，并對硬件設(shè)計進行了Verilog實現(xiàn)。在離散小波變換的VLSI實現(xiàn)中，采用了行-列基的二維離散小波變換VLSI架構(gòu)，并提出了一種正反向小波變換均可復(fù)用的一維離散小波變換的VLSI架構(gòu)；在位平面編碼的硬件實現(xiàn)中，采用了一種特殊的中間緩存架構(gòu)
2、，數(shù)據(jù)和通道跳過的加速方法大大減少了緩存讀取和處理時間；在算術(shù)編解碼器的硬件實現(xiàn)中，提出了一種重整化和讀寫I、Q表并行操作的流水線架構(gòu)；在打/解包模塊的硬件實現(xiàn)中，采用了量化作為碼率控制策略，實現(xiàn)了EBCOTTier-2編碼的硬件集成。最后，整個JPEG2000Codec硬件系統(tǒng)在Xilinx公司的VirtexE1000eFPGA上驗證通過，并作為數(shù)碼相機專用芯片的一部分分別在TSMC0.25um和SMIC0.18umCMOS數(shù)字工藝進
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