DVB-T系統(tǒng)信道內(nèi)碼解碼的FPGA設(shè)計(jì).pdf_第1頁(yè)
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文檔簡(jiǎn)介

1、本論文主要介紹了歐洲數(shù)字電視地面?zhèn)鬏敇?biāo)準(zhǔn)DVB-T系統(tǒng)信道內(nèi)碼解碼部分所有模塊的方案設(shè)計(jì),算法仿真及FPGA硬件電路設(shè)計(jì).內(nèi)碼解碼部分模塊包括星座解映射模塊,比特解交織模塊,數(shù)據(jù)格式轉(zhuǎn)換模塊,符號(hào)解交織模塊,解增信刪余以及Viterbi譯碼模塊.其中,本人根據(jù)DVB-T星座映射圖的規(guī)律,提出了一種8電平量化的星座解映射方法,其次,按照DVB-T內(nèi)交織的方案,本人設(shè)計(jì)了解比特交織和解符號(hào)交織的方案并完成其硬件設(shè)計(jì).最后,通過(guò)對(duì)各種Vite

2、rbi算法的比較,本人選取了8電平量化,截尾譯碼深度為54的寄存器交換算法作為本方案的卷積碼解碼算法,并完成其FPGA設(shè)計(jì).本論文首先介紹了DVB-T基本原理,接著對(duì)DVB-T信道編碼方案進(jìn)行了詳細(xì)的闡述,這是本人制定信道內(nèi)碼解碼方案的基礎(chǔ).然后,在對(duì)內(nèi)碼解碼所有模塊進(jìn)行C語(yǔ)言和MATLAB算法仿真的基礎(chǔ)上,完成了內(nèi)碼解碼總模塊的FPGA設(shè)計(jì),系統(tǒng)所有的硬件電路設(shè)計(jì)都采用了Verilog HDL語(yǔ)言編寫.最后,通過(guò)在Quartus Ⅱ下

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