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文檔簡介
1、隨著通信、計算等技術(shù)的快速發(fā)展,以及軍事與民用對傳輸信息的更高要求,糾錯碼技術(shù)需要被更廣泛應(yīng)用到實際當(dāng)中,現(xiàn)在它已經(jīng)成為大部分通信系統(tǒng)中不可或缺的一項關(guān)鍵技術(shù)。
本文以Turbo碼譯碼器的FPGA實現(xiàn)為目標(biāo),對Turbo碼的迭代譯碼算法及用硬件語言實現(xiàn)其譯碼算法進行了深入研究。
本文介紹了Turbo碼編碼系統(tǒng)的結(jié)構(gòu),重點研究了系統(tǒng)遞歸卷積碼(RSC)和交織器的特點及二者在Turbo碼中的作用。接著介紹了譯碼系
2、統(tǒng)的結(jié)構(gòu),重點研究了Turbo碼MAP算法及其衍生算法LOG_MAP和MAX_LOG_MAP算法。
在本文的設(shè)計中,綜合考慮了多種因素,選擇了Aletra公司的Cyclone IIFPGA器件,采用“自上而下”和“自下而上”的設(shè)計方法實現(xiàn)Turbo碼的編碼及MAX_LOG_MAP算法譯碼。首先分析系統(tǒng)功能,并將其分解成不同的功能模塊,再用Verilog語言去實現(xiàn)每個功能模塊。在各個模塊設(shè)計完成和功能驗證正確后,再將各個模塊
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