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文檔簡介
1、在IGBT換路過程中,回路雜散電感會引起過電壓、損耗及電磁干擾等問題。減小直流電容和半導體器件之間的母排雜散電感是一種有效抑制上述問題的方法。低感母排電感測量存在兩方面的困難。由于低感母排電感很小,準確測量比較困難;同一低感母排存在多個直流電容輸入端口,這些端口即為電感的等效激勵輸入端口,因此實際低感母排的電感是由多個具有空間分布性的分電感合成的總電感,這又給總電感的測量帶來了困難。
為了獲得母排上多個分電感合成的總電感值,本
2、論文提出了平面幾何合成法?;谀概诺膶嶋H結(jié)構,該合成法將電感視作有方向的物理量,即矢量,并應用平面幾何合成法獲得總電感。為了減小測量引線造成的誤差,本文提出了一種改進測量方法,設計了用兩根緊挨并行漆包線作為測量引線,進而減小了引線間的外電感,并在母排連接線末端設計了兩個短的銅制圓柱體作為接線柱,使得這種連接方式與實際的連接更相符,從而規(guī)范了測量過程。
基于實際設計的低感母排,該母排有15個與直流電容相連接的輸入端口,采用阻抗分
3、析儀分別測量了母排的單個端口的分電感。對比不同的測量方案,驗證了銅制的漆包線用于連接阻抗分析儀和母排的可行性。對于母排的15個雜散電感,將各自的激勵施加在相應的電容器端口的情況下,利用三維電磁仿真方法對其進行了研究。與仿真結(jié)果對比,驗證了測量的準確性與可行性。此外還研究了兩個平行板和短接引腳對電感值貢獻。研究表明適當減小連接線的面積可以使總電感值大大減小?;诜抡嬗嬎愕玫降姆蛛姼兄担瑧脦缀魏铣煞ㄓ嬎懔丝傠姼?。將合成總電感與一次性仿真獲
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